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informatik artikel (Interpretation und charakterisierung)

Timer 0 bzw. timer 1 overflow


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TCON 8F 8E 8D 8C 8B 8A 89 88 / Timer 1 Overflow Interrupt

88h TF1 TR1 TF0 TR0 IE1 IT1 IE0 IT0
Timer Control Register TCON

IEN0 AF AE AD AC AB AA A9 A8
A8h EA EAD ES1 ES0 ET1 EX1 ET0 EX0

Interrupt Enable Register IEN0
IP0 BF BE BD BC BB BA B9 B8

B8h - PAD PS1 PS0 PT1 PX1 PT0 PX0
Interrupt Priority Register IP0

TF0 und TF1 werden bei einem Überlauf von Timer 0 bzw. Timer 1 gesetzt (außer bei Timer 0 Mode 3), sie werden bei Aufruf der Interrupt Service Routine wieder rückgesetzt. Die Priorität der Interrupts wird über PT0 und PT1 gesetzt. Über ET0 und ET1 können die Interrupts enabled bzw. disabled werden.

 
 




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